Uso de PROTEUS y la CYCLONE II para la Enseñanza Práctica de VHDL y FPGA por medio de Software y Hardware
Descripción del Articulo
This article aims to work with PROTEUS and the Cyclone II FPGA to design a 3-bit counter circuit in software and hardware. For the software part, PROTEUS will be used, and it comes with the GAL22v10, a reprogrammable CPLD manufactured by the company Lattice Semiconductors. The VHDL description will...
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| Formato: | artículo |
| Fecha de Publicación: | 2024 |
| Institución: | Universidad Ricardo Palma |
| Repositorio: | Revistas - Universidad Ricardo Palma |
| Lenguaje: | español |
| OAI Identifier: | oai:oai.revistas.urp.edu.pe:article/6968 |
| Enlace del recurso: | http://revistas.urp.edu.pe/index.php/Perfiles_Ingenieria/article/view/6968 |
| Nivel de acceso: | acceso abierto |
| Materia: | FPGA, cyclone II, VHDL, PROTEUS |
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Uso de PROTEUS y la CYCLONE II para la Enseñanza Práctica de VHDL y FPGA por medio de Software y HardwareLandaeta, Pedro SelencioFPGA, cyclone II, VHDL, PROTEUSFPGA, cyclone II, VHDL, PROTEUSThis article aims to work with PROTEUS and the Cyclone II FPGA to design a 3-bit counter circuit in software and hardware. For the software part, PROTEUS will be used, and it comes with the GAL22v10, a reprogrammable CPLD manufactured by the company Lattice Semiconductors. The VHDL description will be made using the Cypress Warp Galaxy software, it generates a .jed file from the constructed VHDL file, the .jed file is used to record it in the GAL and thus be able to simulate the description made. The Galaxy software is free to use and a virtual machine is required because it works with Windows XP. Virtual Box will be used as Virtualization software belonging to the ORACLE company. Regarding the FPGA, the cyclone II ep2ct144c8n from the INTEL FPGA company will be used. Which will be programmed with the Quartus II 13.0 sp1 software. As a result, the circuit will be simulated in PROTEUS with the GAL 22V10 and in hardware with the cyclone II card.— El presente artículo tiene como objetivo trabajar con PROTEUS y la FPGA Cyclone II para diseñar un circuito contador de 3 bits en software y hardware. Para la parte de software se usará PROTEUS, ya éste trae la GAL22v10, CPLD reprogramable fabricada por la empresa Lattice Semiconductors. La descripción VHDL se hará por medio del software Cypress Warp Galaxy, éste genera un archivo .jed a partir del archivo VHDL construido, el archivo .jed se usa para grabarlo en la GAL y poder así simular la descripción hecha. El software Galaxy es de libre uso y se necesita una máquina virtual porque trabaja con Windows XP. Se usará Virtual Box como software de Virtualización perteneciente a la empresa ORACLE. En lo que respecta a la FPGA, se usará la cyclone II ep2ct144c8n de la empresa INTEL FPGA. La cual se va a programar con el software Quartus II 13.0 sp1. Como resultado se tendrá el circuito simulado en PROTEUS con la GAL 22V10 y en hardware con la tarjeta cyclone II. Universidad Ricardo Palma2024-12-31info:eu-repo/semantics/articleinfo:eu-repo/semantics/publishedVersionapplication/pdfhttp://revistas.urp.edu.pe/index.php/Perfiles_Ingenieria/article/view/696810.31381/perfilesingenieria.v21i22.6968Engineering Profiles; Vol. 21 No. 22 (2024): Perfiles de Ingeniería (july-december) 2024; 60-76Perfiles de Ingeniería; Vol. 21 Núm. 22 (2024): Perfiles de Ingeniería (julio-diciembre) 2024; 60-762519-57191996-666010.31381/perfilesingenieria.v21i22reponame:Revistas - Universidad Ricardo Palmainstname:Universidad Ricardo Palmainstacron:URPspahttp://revistas.urp.edu.pe/index.php/Perfiles_Ingenieria/article/view/6968/11418Derechos de autor 2024 Pedro Selencio Landaetahttps://creativecommons.org/licenses/by/4.0/info:eu-repo/semantics/openAccessoai:oai.revistas.urp.edu.pe:article/69682025-01-03T14:00:58Z |
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